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Low Skew, 1-to-16 Differential-to- LVDS, Clock Distribution Chip

FEATURES ? Sixteen Differential LVDS outputs ? CLK, nCLK pair can accept the following differential input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL ? Maximum output frequency: 700MHz ? Translates any differential input signal (LVPECL, LVHSTL, SSTL, DCM) to LVDS levels without external bias ne

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Low Skew, 1-to-16 Differential-to-LVDS, Clock Distribution Chip

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Low Skew, 1-to-16 Differential-to-LVDS, Clock Distribution Chip

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更新時間：2025-8-31 23:01:01
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