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CDx4HC112, CDx4HCT112 Dual J-K Flip-Flop with Set and Reset with Negative-Edge Trigger

1 Features ? Hysteresis on clock inputs for improved noise immunity and increased input rise and fall times ? Asynchronous set and reset ? Complementary outputs ? Buffered inputs ? Typical fMAX = 60 MHz at VCC = 5 V, CL = 15 pF, TA = 25℃ ? Fanout (over temperature range) – Standard output

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德州儀器

Dual J-K Flip-Flop with Set and Reset Negative-Edge Trigger

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Dual J-K Flip-Flop with Set and Reset Negative-Edge Trigger

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Dual J-K Flip-Flop with Set and Reset Negative-Edge Trigger

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CDx4HC112, CDx4HCT112 Dual J-K Flip-Flop with Set and Reset with Negative-Edge Trigger

1 Features ? Hysteresis on clock inputs for improved noise immunity and increased input rise and fall times ? Asynchronous set and reset ? Complementary outputs ? Buffered inputs ? Typical fMAX = 60 MHz at VCC = 5 V, CL = 15 pF, TA = 25℃ ? Fanout (over temperature range) – Standard output

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Dual J-K Flip-Flops with Preset and Clear

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NSCNational Semiconductor (TI)

美國國家半導(dǎo)體美國國家半導(dǎo)體公司

CD54HCT112F產(chǎn)品屬性

  • 類型

    描述

  • 型號

    CD54HCT112F

  • 制造商

    Rochester Electronics LLC

  • 功能描述

    - Bulk

更新時間：2025-9-18 10:20:00
IC供應(yīng)商 芯片型號 品牌 批號 封裝 庫存 備注 價格
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CDDIP
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    2020-7-17

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